H.264的编码和解码

发布网友 发布时间：2022-04-19 16:43

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热心网友 时间：2022-07-09 20:15

请参见：列表的照相机与板载视频流编码
因为 H.264 编码和解码要求大量的计算能力在特定类型的算术运算，在通用 Cpu 运行的软件实现高效率通常较少力量。不过，最新的四核通用 x 86 Cpu 有足够的计算能力来执行实时标清及高清编码。压缩效率取决于视频的算法实现，不在是否使用硬件或软件来实现。因此，硬件和软件基于的执行更是电源效率、 灵活性和成本之间的差异。为提高电源效率和减少硬件形式因素，可能雇用专用硬件，为完整的编码或解码过程中，或在 CPU 控制的环境内加速援助。
基于 CPU 的解决办法是已知是灵活得多，尤其是编码必须进行时同时多格式、 多比特率和各项决议 （多屏幕视频） 和可能用上的容器格式支持的附加功能，先进综合的广告功能等。基于 CPU 的软件解决方案通常使得更容易在相同的 CPU 内的多个并发编码会话进行负载平衡。
介绍了在 2011 年 1 月 CES （消费电子展) 的第 2 代英特尔桑迪桥酷睿 i3/i5/i7处理器提供称为英特尔快速同步视频上芯片硬件全面高清 H.264 编码器。
硬件 H.264 编码器可以是ASIC或FPGA。FPGA 是一个一般的可编程芯片。要使用 FPGA 作为硬件编码器，H.264 编码器设计需要自定义应用程序的芯片。完整的高清 H.264 编码器可以在一个单一的低成本 FPGA 芯片上运行 2009 年 (高配置文件、 水平 4.1，1080p，30 帧/秒)。
ASIC 编码器与 H.264 编码器功能，可从许多不同的半导体公司，但在 ASIC 中使用的核心设计通常由芯片及媒体， On2 (原 Hantro，由谷歌收购），想象力的技术，NGCodec 等几个公司的一个授权。一些公司已提供的 FPGA 和 ASIC 产品。
德州仪器生产一线的ARM+ 执行 DSP H264 BP 的 DSP 内核编码 1080p 30 帧每秒。这允许 （其中，作为高度优化的 DSP 代码实现） 的编解码器的灵活性时正在比通用 CPU 上的软件效率更高。